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高速ADC 的電源設(shè)計(jì)


  來源: 儀器儀表商情網(wǎng) 時(shí)間:2015-12-30 作者:Stanford
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就一個(gè)要求3.3-V電壓軌的數(shù)據(jù)轉(zhuǎn)換器而言,300mVLDO壓降增加約10%ADC功耗。這種效應(yīng)在數(shù)據(jù)轉(zhuǎn)換器中得到放大,因?yàn)樗哂懈〉墓に嚬?jié)點(diǎn)和更低的電源電壓。例如,1.8V時(shí),相同300-mV壓降增加約17%(300mV/1.8V)ADC功耗。因此,將該鏈的低噪聲LDO去除可以產(chǎn)生巨大的節(jié)能效果。去除LDO還可以降低設(shè)計(jì)的板級空間、熱量以及成本。

本文闡述了包括超高性能16ADC在內(nèi)的一些TI高速ADC可在ADC性能無明顯降低的條件下直接通過開關(guān)穩(wěn)壓器驅(qū)動。為了闡述的方便,我們對兩款不同的數(shù)據(jù)轉(zhuǎn)換器(一款使用高性能BiCOM技術(shù)(TIADS5483),另 一款使用低功耗CMOS技術(shù)(TIADS6148)進(jìn)行了開關(guān)電源噪聲敏感性研 究。本文的其他部分對所得結(jié)果進(jìn)行了一一介紹。

BiCOM技術(shù)—ADS5483

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